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R1EX25512ASA00A/R1EX25512ATA00A
AC Characteristics
Test Conditions
? Input pulse levels:
? V IL = V CC × 0.2
? V IH = V CC × 0.8
? Input rise and fall time: ≤ 5 ns
? Input timing reference levels: V CC × 0.5
? Output reference levels: V CC × 0.5
? Output load: 1TTL Gate + 100 pF
(Ta = ? 40 to + 85 ° C, V CC = 2.5 V to 5.5 V)
Parameter
Clock frequency
S active setup time
S not active setup time
S deselect time
S active hold time
S not active hold time
Clock high time
Clock low time
Clock rise time
Clock fall time
Data in setup time
Data in hold time
Clock low hold time after HOLD not active
Clock low hold time after HOLD active
Clock high setup time before HOLD active
Clock high setup time before HOLD not
Symbol
f C
t SLCH
t SHCH
t SHSL
t CHSH
t CHSL
t CH
t CL
t CLCH
t CHCL
t DVCH
t CHDX
t HHCH
t HLCH
t CHHL
t CHHH
Alt
f SCK
t CSS1
t CSS2
t CS
t CSH
?
t CLH
t CLL
t RC
t FC
t DSU
t DH
?
?
?
?
Min
?
90
90
90
90
90
90
90
?
?
20
30
70
40
60
60
Max
5
?
?
?
?
?
?
?
1
1
?
?
?
?
?
?
Unit
MHz
ns
ns
ns
ns
ns
ns
ns
μ s
μ s
ns
ns
ns
ns
ns
ns
Notes
1
1
2
2
active
Output disable time
Clock low to output valid
Output hold time
Output rise time
Output fall time
HOLD high to output low-Z
HOLD low to output low-Z
Write time
t SHQZ
t CLQV
t CLQX
t QLQH
t QHQL
t HHQX
t HLQZ
t W
t DIS
t V
t HO
t RO
t FO
t LZ
t HZ
t WC
?
?
0
?
?
?
?
?
100
60
?
50
50
50
100
5
ns
ns
ns
ns
ns
ns
ns
ms
2
2
2
2
2
Notes: 1. t CH + t CL ≥ 1/f C
2. Not 100 % tested
R10DS0046EJ0200 Rev.2.00
Oct.04, 2010
Page 5 of 20
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